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实现补码加减运算的逻辑电路运算前,X、Y寄存器分别存储被加(减)数和加(减)数,计算结果存回X寄存器;F为加法器,能在命令X→F和Y→F信号的控制下接收两个寄存器中的数据并完成加法运算,运算结果在F→X为实现减运算,应将Y寄存器中补码数据的负数表示送到加法器F,这可以通过送Y寄存器中每位数据的反码并在F的最低位给出进位1输入信号变通完成,用/Y→F和1→F控制命令实现。图2.5实现补码加
关键词:
3686 08-10
(1)对多路数据进行选择 (2)实现逻辑函数 例 分别用4选1数据选择器和8选1数据选择器实现逻辑函数F=A⊕B⊕C 解:用8选1数据选择器实现 (1)写出8选8数据选择器的输出函数 (2)将F转换为最小项的标准表达式 将F与Y比较,令A2=A,A1=B,A0=C,F=Y 等式左右相等,可推出 D1=D2=D4=D7=1
关键词:
160 09-30
救F肩动挖制q.IJC僻㈦啦台.把电机定于绕组接成Y肜联接,同时lI S接通,2JC{}}电吸☆,电机Y}臣联i接减iIf/)f~tjj.1 1 5的接通使JMP - S也褂LU r+怍,对电机的转建进行枪删,一j电机转建逃毋l额定转建的600/O,SO%(可按≮际‘睛龇设定).JMPI啦哈.1-7断开.IJC失电释放,Y J陟联接断开1-9接哂.9 - II 133也接通.3JC静电
关键词:
313 08-10
1.外围线路配置 1.1 数字量输入: 端子FWD正向运行 C板:Y 4 F板:JP 10.4 端子REV反向运行 C板:Y5 F板:JP10.5 端子X1 E01=0 多段速频率选择SS1 F板:JP10.7端子X2 E02=1 多段速频率选择SS2 F板:JP10.8 端子X3 E03=2 多段速频率选择SS4 F板:JP10.9 端子CM 公共端 C板:COM2 F板:JP10.10 1
关键词:
832 08-10